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数据加密标准(Data Encryption Standard,DES)自诞生以来,为维护信息安全发挥了十分重要的作用。DES算法是典型的分组对称式私钥密码机制。本文对DES算法的具体实现过程进行深入探讨,并对DES算法的安全性问题进行详细分析。 相似文献
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周微微 《中国高新技术企业评价》2010,(14):30-31
文章介绍了DES加密算法的原理,并对加解密过程进行了论述,在此理论基础上提出了在实际应用DES算法中所遇到的跨平台问题,提出并实现了完整的解决方案。 相似文献
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《中国高新技术企业评价》2010,(21)
文章介绍了DES加密算法的原理,并对加解密过程进行了论述,在此理论基础上提出了在实际应用DES算法中所遇到的跨平台问题,提出并实现了完整的解决方案。 相似文献
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目前,DES分组密码被广泛应用于各个领域,其强大的抗差分攻击和抗线性攻击能力取决于其核心的S-BOX ,但由于其固定,大大减弱了攻击难度,本文提出一种使用相关密钥S-BOX的DES算法,既保持了DES的结构优势,又在一定程度上增强了抗线性攻击力,穷举攻击和选择明文攻击的难度。 相似文献
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网络规模日益扩大、结构复杂化等促进了分布式网络管理系统的发展,由于DES和RSA加密算法在处理效率、密钥管理、算法的安全性、数字签名、认证等方面各有优缺点,因此文章提出将DES和RSA两种加密算法相结合,取两者的优点来保证基于SNMPv3的分布式网络管理系统中的数据安全。 相似文献
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介绍了一种基于安全散列算法的FPGA加密方法,利用加密型EEPROM可对低成本FPGA芯片加密,可有效防止对FPGA设计的非法拷贝,保护设计者的知识产权。 相似文献
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FPGA正在替代ASIC和PDSP用于前端数字信号处理的运算,采用FPGA进行算法运算比PDSP器件具有更高的效率,更低的成本和功耗。文章以设计一个32阶fir滤波器为例,验证采用MATlab的DSPbuider工具可大大提高FPGA编程效率,省去了底层代码编写时间,使设计者更专注于系统级算法的设计。 相似文献
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DES数据加密算法是最著名的对称密钥加密算法,在计算机密码学及计算机数据通信的发展过程中起着重要的作用。分析了DES数据加密算法的基本原理,用JAVA语言实现了对文件的加密。 相似文献
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正交信号发生器的FPGA实现通常都是基于查找表的方法,为了达到高精度要求,需要耗费大量的ROM资源去建立庞大的查找表。文中提出了一种基于流水线CORDIC算法的实现方案,可有效地节省FPGA的硬件资源。并根据DSP开发工具DSP Builder的优点,采用VHDL文本与Simulink模型图相结合的方法进行了FPGA设计,仿真结果验证了设计的正确性及可行性。 相似文献
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本文主要针对数字滤波器代码自动生成问题,在对基于FPGA平台的数字滤波器设计算法进行研究的基础之上,建立一个各种算法均能实现的滤波器代码库,然后主要对开发滤波器代码自动生成系统方面进行了一定的论述。 相似文献
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针对Rein Lien Hsu提出的加入亮度补偿后的椭圆肤色模型在亮度较高和较低的区域容易误判的问题,提出了根据亮度值来分段选择椭圆长短半轴参数值的改进方法,MATLAB实验仿真表明改进后的算法比原始椭圆模型算法具有更高的适用性和准确性,搭建的FPGA系统能够满足人脸的实时检测需求。 相似文献
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一种高效的DSP与FPGA的数据交换结构设计 总被引:1,自引:0,他引:1
常规DSP与FPGA构架系统中,在进行数据交换时,由于DSP资源过多的被占用来进行数据处理和准备,增加软件执行时间,从而导致系统整体的执行效率下降。为了提高DSP结合FPGA构架系统的执行效率,本文设计了一种高效的DSP与FPGA数据交换结构,该结构结合FPGA并行处理的特点,FPGA内部完成对外部数据进行分类、解码、转换处理,从而提高了DSP的执行效率。 相似文献
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针对空间链路数据传输速率的提高,设计了一种基于嵌入式PowerPC和FPGA平台的高速、可配置的实时帧处理系统。主要描述了系统的硬件电路,采用了PowerPC作为主处理器进行控制与数据处理;采用FPGA作为外部输入输出接口,并进行CCSDS帧的解析处理。FPGA映射到PowerPC中EMIF一段地址空间,通过总线进行数据交互。FPGA设计采用VHDL语言描述,主要对帧同步机制、RS译码进行设计。PowerPC设计采用Vxworks系统,满足实时性要求。实践证明系统的高速性和高可靠性。 相似文献
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本文介绍了第三代视频监控系统的现状,针对其向更高质量视频、高分辨率以及灵活性和功能的需求过渡的过程中发生的技术问题,结合FPGA的可重复编程、便于容纳不确定的模块架构及可进行动态重构等优势,探讨了实现高清快速传输、高效动态通信等问题。 相似文献
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UART因其可靠性高,传输距离远,线路简单而成为比较广泛的串行数据通信电路,而现在大部分集成电路通信用的UART芯片,存在成本高,电路复杂,移植性较差等缺点,本文提出了一种基于FPGA的嵌入式UART模块化设计方法,将UART模块集成到FPGA上,而这些模块功能全部基于verilogHDL硬件描述语言,并通过有限状态机来实现,增强了设计的灵活性,降低了成本,并可以作为一个IP核,移植到其它FPGA嵌入式系统中,可移植性增强。 相似文献