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VHDL在数字电路设计中的应用
作者姓名:刘文君
作者单位:日照广播电视大学
摘    要:文章介绍了VHDL语言及其基本特点,讨论了VHDL语言在数字电路设计中的诸多优点,通过十位计数器的实例介绍了在MAX+plus Ⅱ环境下运用VHDL语言设计实际电路的具体方法和步骤.结果表明VHDL语言应用于数字电路仿真的灵活性及直观性.

关 键 词:数字电路    仿真
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