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| C频段小步进低相噪频率合成器的设计与实现 | |
| 作者姓名： | 冯占群 李青平 |
| 作者单位： | 中国电子科技集团公司电子第五十四研究所 |
| 摘 要： | 本文介绍了C频段小步进低相噪频率合成器的设计与实现.在研制中通过采用混频式锁相环方案,大大降低了环内分频比,引入DDS激励PLL设计理念,选用低噪声器件,以及采用D/A预置方式引导捕获电路,从而实现了低相噪、低杂散、小步进等指标.并通过对频率合成器的指标分析,阐述了在混频式锁相环方案各部分的工作原理及在设计过程中需要注意的一些问题. |
| 关 键 词： | DDS PLL 低杂散 低相位噪声 小步进 |
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